uni/inf2270/lol/addsub.circ

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<project source="2.13.20" version="1.0">
This file is intended to be loaded by Logisim-evolution (https://github.com/reds-heig/logisim-evolution).
<lib desc="#Wiring" name="0"/>
  <lib desc="#Gates" name="1">
    <tool name="AND Gate">
      <a name="size" val="30"/>
    </tool>
    <tool name="OR Gate">
      <a name="facing" val="south"/>
      <a name="size" val="30"/>
    </tool>
    <tool name="XOR Gate">
      <a name="size" val="30"/>
    </tool>
  </lib>
  <lib desc="#Plexers" name="2">
    <tool name="Multiplexer">
      <a name="enable" val="false"/>
    </tool>
    <tool name="Demultiplexer">
      <a name="enable" val="false"/>
    </tool>
  </lib>
  <lib desc="#Arithmetic" name="3"/>
  <lib desc="#Memory" name="4">
    <tool name="ROM">
      <a name="contents">addr/data: 8 8
0
</a>
    </tool>
  </lib>
  <lib desc="#I/O" name="5">
    <tool name="Button">
      <a name="facing" val="south"/>
    </tool>
    <tool name="DipSwitch">
      <a name="labelloc" val="south"/>
      <a name="number" val="2"/>
    </tool>
    <tool name="LED">
      <a name="facing" val="north"/>
    </tool>
  </lib>
  <lib desc="#HDL-IP" name="6">
    <tool name="VHDL Entity">
      <a name="content">--------------------------------------------------------------------------------
-- HEIG-VD, institute REDS, 1400 Yverdon-les-Bains
-- Project :
-- File    :
-- Autor   :
-- Date    :
--
--------------------------------------------------------------------------------
-- Description :
--
--------------------------------------------------------------------------------

library ieee;
  use ieee.std_logic_1164.all;
  --use ieee.numeric_std.all;

entity VHDL_Component is
  port(
  ------------------------------------------------------------------------------
  --Insert input ports below
    horloge_i  : in  std_logic;                    -- input bit example
    val_i      : in  std_logic_vector(3 downto 0); -- input vector example
  ------------------------------------------------------------------------------
  --Insert output ports below
    max_o      : out std_logic;                    -- output bit example
    cpt_o      : out std_logic_Vector(3 downto 0)  -- output vector example
    );
end VHDL_Component;

--------------------------------------------------------------------------------
--Complete your VHDL description below
architecture type_architecture of VHDL_Component is


begin


end type_architecture;
</a>
    </tool>
  </lib>
  <lib desc="#TCL" name="7">
    <tool name="TclGeneric">
      <a name="content">library ieee;
use ieee.std_logic_1164.all;

entity TCL_Generic is
  port(
    --Insert input ports below
    horloge_i  : in  std_logic;                    -- input bit example
    val_i      : in  std_logic_vector(3 downto 0); -- input vector example

	  --Insert output ports below
    max_o      : out std_logic;                    -- output bit example
    cpt_o      : out std_logic_Vector(3 downto 0)  -- output vector example
  );
end TCL_Generic;
</a>
    </tool>
  </lib>
  <lib desc="#Base" name="8">
    <tool name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
  </lib>
  <lib desc="#BFH-Praktika" name="9"/>
  <main name="main"/>
  <options>
    <a name="gateUndefined" val="ignore"/>
    <a name="simlimit" val="1000"/>
    <a name="simrand" val="0"/>
    <a name="tickmain" val="half_period"/>
  </options>
  <mappings>
    <tool lib="8" map="Button2" name="Menu Tool"/>
    <tool lib="8" map="Button3" name="Menu Tool"/>
    <tool lib="8" map="Ctrl Button1" name="Menu Tool"/>
  </mappings>
  <toolbar>
    <tool lib="8" name="Poke Tool"/>
    <tool lib="8" name="Edit Tool"/>
    <tool lib="8" name="Text Tool">
      <a name="text" val=""/>
      <a name="font" val="SansSerif plain 12"/>
      <a name="halign" val="center"/>
      <a name="valign" val="base"/>
    </tool>
    <sep/>
    <tool lib="0" name="Pin"/>
    <tool lib="0" name="Pin">
      <a name="facing" val="west"/>
      <a name="output" val="true"/>
      <a name="labelloc" val="east"/>
    </tool>
    <tool lib="1" name="NOT Gate"/>
    <tool lib="1" name="AND Gate"/>
    <tool lib="1" name="OR Gate"/>
  </toolbar>
  <circuit name="main">
    <a name="circuit" val="main"/>
    <a name="clabel" val=""/>
    <a name="clabelup" val="east"/>
    <a name="clabelfont" val="SansSerif bold 16"/>
    <a name="circuitnamedbox" val="true"/>
    <a name="circuitvhdlpath" val=""/>
    <wire from="(330,320)" to="(390,320)"/>
    <wire from="(330,680)" to="(390,680)"/>
    <wire from="(320,240)" to="(320,250)"/>
    <wire from="(330,490)" to="(330,500)"/>
    <wire from="(330,130)" to="(330,140)"/>
    <wire from="(320,600)" to="(320,610)"/>
    <wire from="(280,520)" to="(280,540)"/>
    <wire from="(270,110)" to="(270,130)"/>
    <wire from="(280,160)" to="(280,180)"/>
    <wire from="(200,550)" to="(200,640)"/>
    <wire from="(200,190)" to="(200,280)"/>
    <wire from="(170,410)" to="(170,440)"/>
    <wire from="(170,770)" to="(170,800)"/>
    <wire from="(180,440)" to="(210,440)"/>
    <wire from="(250,270)" to="(280,270)"/>
    <wire from="(180,800)" to="(210,800)"/>
    <wire from="(170,500)" to="(260,500)"/>
    <wire from="(170,140)" to="(260,140)"/>
    <wire from="(250,630)" to="(280,630)"/>
    <wire from="(260,290)" to="(280,290)"/>
    <wire from="(260,770)" to="(280,770)"/>
    <wire from="(260,410)" to="(280,410)"/>
    <wire from="(260,650)" to="(280,650)"/>
    <wire from="(380,290)" to="(400,290)"/>
    <wire from="(380,650)" to="(400,650)"/>
    <wire from="(400,160)" to="(400,200)"/>
    <wire from="(390,230)" to="(390,270)"/>
    <wire from="(400,520)" to="(400,560)"/>
    <wire from="(390,590)" to="(390,630)"/>
    <wire from="(390,590)" to="(400,590)"/>
    <wire from="(390,230)" to="(400,230)"/>
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    <wire from="(310,190)" to="(320,190)"/>
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    <wire from="(320,700)" to="(400,700)"/>
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    <wire from="(260,140)" to="(260,200)"/>
    <wire from="(330,770)" to="(390,770)"/>
    <wire from="(330,410)" to="(390,410)"/>
    <wire from="(330,220)" to="(330,230)"/>
    <wire from="(320,690)" to="(320,700)"/>
    <wire from="(320,330)" to="(320,340)"/>
    <wire from="(330,580)" to="(330,590)"/>
    <wire from="(280,250)" to="(280,270)"/>
    <wire from="(280,610)" to="(280,630)"/>
    <wire from="(200,280)" to="(200,370)"/>
    <wire from="(200,640)" to="(200,730)"/>
    <wire from="(170,140)" to="(170,170)"/>
    <wire from="(170,500)" to="(170,530)"/>
    <wire from="(180,170)" to="(210,170)"/>
    <wire from="(180,530)" to="(210,530)"/>
    <wire from="(250,360)" to="(280,360)"/>
    <wire from="(170,230)" to="(260,230)"/>
    <wire from="(170,590)" to="(260,590)"/>
    <wire from="(250,720)" to="(280,720)"/>
    <wire from="(260,500)" to="(280,500)"/>
    <wire from="(260,740)" to="(280,740)"/>
    <wire from="(260,140)" to="(280,140)"/>
    <wire from="(260,380)" to="(280,380)"/>
    <wire from="(380,380)" to="(400,380)"/>
    <wire from="(380,740)" to="(400,740)"/>
    <wire from="(400,610)" to="(400,650)"/>
    <wire from="(390,680)" to="(390,720)"/>
    <wire from="(400,250)" to="(400,290)"/>
    <wire from="(390,320)" to="(390,360)"/>
    <wire from="(390,320)" to="(400,320)"/>
    <wire from="(380,630)" to="(390,630)"/>
    <wire from="(390,680)" to="(400,680)"/>
    <wire from="(310,280)" to="(320,280)"/>
    <wire from="(340,190)" to="(350,190)"/>
    <wire from="(310,640)" to="(320,640)"/>
    <wire from="(380,270)" to="(390,270)"/>
    <wire from="(340,550)" to="(350,550)"/>
    <wire from="(200,370)" to="(210,370)"/>
    <wire from="(320,790)" to="(400,790)"/>
    <wire from="(320,430)" to="(400,430)"/>
    <wire from="(200,730)" to="(210,730)"/>
    <wire from="(260,230)" to="(260,290)"/>
    <wire from="(260,590)" to="(260,650)"/>
    <wire from="(200,130)" to="(200,190)"/>
    <wire from="(330,500)" to="(390,500)"/>
    <wire from="(330,140)" to="(390,140)"/>
    <wire from="(320,420)" to="(320,430)"/>
    <wire from="(330,670)" to="(330,680)"/>
    <wire from="(330,310)" to="(330,320)"/>
    <wire from="(320,780)" to="(320,790)"/>
    <wire from="(280,700)" to="(280,720)"/>
    <wire from="(280,340)" to="(280,360)"/>
    <wire from="(200,730)" to="(200,820)"/>
    <wire from="(200,370)" to="(200,460)"/>
    <wire from="(170,590)" to="(170,620)"/>
    <wire from="(170,230)" to="(170,260)"/>
    <wire from="(200,820)" to="(200,850)"/>
    <wire from="(180,260)" to="(210,260)"/>
    <wire from="(180,620)" to="(210,620)"/>
    <wire from="(170,680)" to="(260,680)"/>
    <wire from="(170,320)" to="(260,320)"/>
    <wire from="(250,450)" to="(280,450)"/>
    <wire from="(250,810)" to="(280,810)"/>
    <wire from="(260,230)" to="(280,230)"/>
    <wire from="(260,470)" to="(280,470)"/>
    <wire from="(260,590)" to="(280,590)"/>
    <wire from="(260,830)" to="(280,830)"/>
    <wire from="(380,470)" to="(400,470)"/>
    <wire from="(380,830)" to="(400,830)"/>
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    <wire from="(390,410)" to="(390,450)"/>
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    <wire from="(390,770)" to="(390,810)"/>
    <wire from="(390,770)" to="(400,770)"/>
    <wire from="(390,410)" to="(400,410)"/>
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    <wire from="(320,160)" to="(400,160)"/>
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    <wire from="(200,820)" to="(210,820)"/>
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    <wire from="(200,130)" to="(270,130)"/>
    <wire from="(270,130)" to="(330,130)"/>
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    <wire from="(330,590)" to="(390,590)"/>
    <wire from="(320,150)" to="(320,160)"/>
    <wire from="(330,400)" to="(330,410)"/>
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    <wire from="(330,760)" to="(330,770)"/>
    <wire from="(280,430)" to="(280,450)"/>
    <wire from="(280,790)" to="(280,810)"/>
    <wire from="(200,460)" to="(200,550)"/>
    <wire from="(170,320)" to="(170,350)"/>
    <wire from="(170,680)" to="(170,710)"/>
    <wire from="(180,350)" to="(210,350)"/>
    <wire from="(250,180)" to="(280,180)"/>
    <wire from="(180,710)" to="(210,710)"/>
    <wire from="(170,410)" to="(260,410)"/>
    <wire from="(170,770)" to="(260,770)"/>
    <wire from="(250,540)" to="(280,540)"/>
    <wire from="(260,200)" to="(280,200)"/>
    <wire from="(260,680)" to="(280,680)"/>
    <wire from="(260,320)" to="(280,320)"/>
    <wire from="(260,560)" to="(280,560)"/>
    <wire from="(380,200)" to="(400,200)"/>
    <wire from="(380,560)" to="(400,560)"/>
    <wire from="(390,140)" to="(390,180)"/>
    <wire from="(400,790)" to="(400,830)"/>
    <wire from="(400,430)" to="(400,470)"/>
    <wire from="(390,500)" to="(390,540)"/>
    <wire from="(390,500)" to="(400,500)"/>
    <wire from="(380,810)" to="(390,810)"/>
    <wire from="(310,460)" to="(320,460)"/>
    <wire from="(340,370)" to="(350,370)"/>
    <wire from="(310,820)" to="(320,820)"/>
    <wire from="(390,140)" to="(400,140)"/>
    <wire from="(380,450)" to="(390,450)"/>
    <wire from="(340,730)" to="(350,730)"/>
    <wire from="(320,250)" to="(400,250)"/>
    <wire from="(200,550)" to="(210,550)"/>
    <wire from="(200,190)" to="(210,190)"/>
    <wire from="(320,610)" to="(400,610)"/>
    <wire from="(260,410)" to="(260,470)"/>
    <wire from="(260,770)" to="(260,830)"/>
    <comp lib="1" loc="(310,280)" name="AND Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(310,730)" name="AND Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(330,760)" name="OR Gate">
      <a name="facing" val="south"/>
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(350,550)" name="AND Gate">
      <a name="facing" val="west"/>
      <a name="size" val="30"/>
    </comp>
    <comp lib="5" loc="(440,150)" name="LED"/>
    <comp lib="8" loc="(135,377)" name="Text">
      <a name="text" val="4"/>
      <a name="font" val="SansSerif plain 12"/>
    </comp>
    <comp lib="1" loc="(320,600)" name="XOR Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(350,640)" name="AND Gate">
      <a name="facing" val="west"/>
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(350,820)" name="AND Gate">
      <a name="facing" val="west"/>
      <a name="size" val="30"/>
    </comp>
    <comp lib="8" loc="(139,649)" name="Text">
      <a name="text" val="32"/>
      <a name="font" val="SansSerif plain 12"/>
    </comp>
    <comp lib="8" loc="(135,197)" name="Text">
      <a name="text" val="1"/>
      <a name="font" val="SansSerif plain 12"/>
    </comp>
    <comp lib="5" loc="(160,440)" name="DipSwitch">
      <a name="labelvisible" val="true"/>
      <a name="number" val="2"/>
    </comp>
    <comp lib="5" loc="(160,800)" name="DipSwitch">
      <a name="labelvisible" val="true"/>
      <a name="number" val="2"/>
    </comp>
    <comp lib="1" loc="(250,720)" name="XOR Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(310,550)" name="AND Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="5" loc="(440,600)" name="LED"/>
    <comp lib="5" loc="(160,620)" name="DipSwitch">
      <a name="labelvisible" val="true"/>
      <a name="number" val="2"/>
    </comp>
    <comp lib="1" loc="(350,460)" name="AND Gate">
      <a name="facing" val="west"/>
      <a name="size" val="30"/>
    </comp>
    <comp lib="1" loc="(320,240)" name="XOR Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="5" loc="(330,850)" name="LED">
      <a name="facing" val="north"/>
    </comp>
    <comp lib="1" loc="(330,310)" name="OR Gate">
      <a name="facing" val="south"/>
      <a name="size" val="30"/>
    </comp>
    <comp lib="8" loc="(142,466)" name="Text">
      <a name="text" val="8"/>
      <a name="font" val="SansSerif plain 12"/>
    </comp>
    <comp lib="1" loc="(310,370)" name="AND Gate">
      <a name="size" val="30"/>
    </comp>
    <comp lib="5" loc="(160,350)" name="DipSwitch">
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    </comp>
    <comp lib="1" loc="(330,490)" name="OR Gate">
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      <a name="text" val="2"/>
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